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Physical Design / Implementation Engineer 채용 (분당)

채용시 마감

경력: 경력 1~15년

학력: 대졸(4년제) 이상(예정자 가능) 전기/전자/ 컴퓨터관련 전공

근무형태: 정규직 수습기간 3개월

급여: 면접 후 결정

근무요일: 주 5일(월~금)

근무지역: 경기 성남시 분당구, 성남시, 수원시, 안양시, 용인시, 서울 강남구, 강서구, 관악구, 광진구, 마포구

최저임금계산에 대한 알림 하단에 명시된 급여, 근무 내용 등이 최저임금에 미달하는 경우 위 내용이 우선합니다.

조회수 516
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Physical Design
Physical Implementation
Engineer

채용

모집부문 및 상세내용

SoC Physical Design Engineer

주요업무

1. Physical Synthesis
2. Floorplan including Multi-level hierarchical design
3. Clock Tree Synthesis
4. Power Planning and Distribution
5. Place and routing
6. Static Timing Analysis and Timing Closure
7. Physicla Verification : DRC, LVS
8. Power Analysis : StaticIR Drop & Dynamic Voltage Drop Analysis, Power & Signal EM Analysis

자격요건
1. 4 년제 대졸이상, 석사 우대
2. Chip Top 경험자 우대: Hierarchy Design 경험 (Over 10 Blocks) , Block Partition, Top CTS
3. CPU/GPU Hardening 경험자 우대
4. P&R Experience: Floorplan, Place & Route, CTS, STA, DRC/LVS, IR Drop (ICC or Innovus, Prime-Time, StarRC, ICV or Calibre, RedHawk)
5. TSMC 16nm/12nm or Samsung 14nm 이하 경험자 우대

SoC Physical Implementation Engineer

주요업무

- DFT Implementation
- SCAN insertion / ATPG / Scan Simulation (Test Compiler / TetraMax)
- BIST/BIRA Insertion & Simulation : Tessent MBIST / JTAG / IJTAG
- SDC Creation & Clean
-Spyglass LINT/SDC/DFT Check
- Logic Synthesis : DC/DCT/DCG
- Equivalence Check : Formality/Conformal
- LDRC : Logic Design Rule Check (Spyglass_LDRC)
- STA (Static Timing Analysis) - Timing Closure : cross-talk/noise/mttv/setup/hold fix (Prime_Time, Physical-aware ECO)
- Low Power Design : UPF Creation & Low power Rule Check(VC_LP)
- Multi-voltage, Multi power domain, Power-gating, Clock-gating.
- Power Analysis : Vectored / Vectorless (PTPX) - Implementation 자동화 Platform 개발
- Simulator & Debugger : VCS / NC-verilog / Verdi

자격요건
1. scripting (shell, tcl, perl, phython, etc.)2. Version Control system (Git, CVS, ClearCase, Perforce, etc.)
3. Bus protocol (AMBA, NoC etc)
4. Fluent in English (Business letter/email reading & writing etc.)

우대사항
• DFT 전문성 보유
• Top level DFT Architecture 설계 경험자
• HPDF DFT 경험자 (Top/Block level)
• ATE Vector setup 및 Yield 개선 업무 경험자
• IJTAG(IEEE1687) 경험자 ( Tessent tool 이용 )
• Hierarchical implementation Flow 경험자
• SEC 14nm 이하 공정 경험자
• CPU (ARM Cortex Series, RISC-V 등) 1.0 GHz 이상 Hardening 경험
• DVFS implementation 경험
• HSI IP Hardening 경험자 (LPDDR4 PHY / PCIe PHY / Ethernet PHY / SerDes PHY)
• 설계 자동화 platform 개발 경험자

근무조건

ㆍ근무형태:정규직

ㆍ근무일시:주 5일(월~금)

ㆍ근무지역:경기도 성남시 분당구 양현로 322 코리아디자인센터

전형절차

서류전형
1차면접
2차면접
최종합격

접수기간 및 방법

ㆍ접수기간:채용 시 마감

ㆍ접수방법:사람인 입사지원

유의사항

ㆍ입사지원 서류에 허위사실이 발견될 경우, 채용확정 이후라도 채용이 취소될 수 있습니다.
ㆍ접수된 서류는 채용과 무관한 곳에는 사용하지 않습니다.
ㆍ '채용절차법'에 의거하여 반환 청구 기간 내 채용서류의 반환을 청구할 수 있습니다.
- 반환 서류 : 채용과정에서 제출한 서류 (*온라인으로 제출한 채용 서류 제외)
- 반환 청구 기간 : 결과 통지일 (채용여부가 확정된 날)로부터 180일 이내
- 반환 청구 신청 : careers@semifive.com 반환 청구 메일 신청
- 서류 반환 절차 : 신청 확인된 날로부터 14일 이내 지정한 주소지로 등기우편 발송
ㆍ 지원 접수일로부터 반환 청구기간이 지난 서류는 별도의 파기 신청이 없더라도 '개인정보보호법'에 의거하여 지체 없이 채용 서류 일체를 파기할 예정입니다.

복리후생

지원금/보험: 각종 경조사 지원

급여제도: 인센티브제, 퇴직금, 4대 보험

선물: 명절선물/귀향비, 생일선물/파티, 웰컴키트 지급

교육/생활: 창립일행사, 신규 입사자 교육(OJT), 점심식사 제공, 사내동호회 운영, 간식 제공

조직문화: 수평적 조직문화, 님/닉네임 문화

근무지위치

(13496) 경기 성남시 분당구 양현로 322 코리아디자인센터 수인분당선 야탑역에서 800m 이내

지도 보기

접수기간 및 방법

채용시 마감되는
공고입니다.

시작일: 2024.05.13 17:00

지원방법
접수양식: 자유양식

인사담당자는 빠른 입사지원을 선호합니다.

지원자 통계

이 공고에 지원한 회원들이 궁금하다면?

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경력, 성별, 학력 등의 현황을 확인하세요!

지원자수: 9명

Physical Engineering: 9명

경력별 현황

신입

1년 미만

1~3년

3~5년

5년 이상

연봉별 현황

2,200
~2,600

2,600
~3,000

3,000
~4,000

4,000
이상

성별 현황

지원자수

남자: 88%; 7 명

여자: 13%; 1 명

연령별 현황

20대

30대

40대

50대

60대 이상

학력별 현황

고졸이하

2~3년제

4년제

석사

박사

외국어 현황

TOEIC

TOEFL

TEPS

TOEIC Speaking

OPIC

JPT

HSK

기타

TOEIC
SPEAKING

IM1이하

IM2

IM3

자격증 현황

생산자동화기능사

전기공사기사

정보처리기사

1종보통운전면허

정보기술자격(I..

기타

자격증 개수

미보유

1개

2개

3개

4개이상

포트폴리오 및 기타문서 제출

2 이력서 2명
3 증명서 1명
포트폴리오 1명 기타 1명

미첨부: 6명

인담자 톡

주식회사 세미파이브 인사담당자님이 2개의 질문에 답변한 내용입니다. 24.05.13 17:41

Q1.근무 환경은 어떤가요?: 내근 100%; 자율 복장

Q2.면접 및 입사는 어떻게 진행되나요?: 접수기간 중 수시 면접; 지원자 1명, 면접관 다수; 입사 일정 조율 가능

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